ISE Design Suite 10.1 的最新消息 - 逻辑设计工具

ISE Design Suite 10.1 提供了一个用于 FPGA 逻辑设计的集成环境。

ISE™ Design Suite 10.1 提供了一个功能强大的前端到后端设计解决方案，可以帮您在更短的时间内实现甚至是最大胆的设计目标。最新版本内的新特性和技术实现了更轻松的引脚规划及更快的运行时间，支持分布式处理，并且改善了功耗管理等。

PlanAhead Lite 简介
所有 ISE Design Suite 配置现在均包含 PlanAhead™ Lite - 获奖的 PlanAhead 设计和分析工具的一部分。PlanAhead 和 PlanAhead Lite 提供了同样简便易用的环境。PlanAhead Lite 提供了 PinAhead 技术的 I/O 引脚规划功能。它还包含设计分析和布局规划功能，以及利用 ExploreAhead 环境实现的实现控制。

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最佳性能

性能比先前的主要版本平均快8%

ISE 10.1 提供了简便易用的技术，可以帮您在更短的时间内实现甚至是最大胆的设计目标。

新 SmartXplorer 利用 Linux 网络内的分布式处理来辨别设计的最佳实现设置和高达 38% 的附加性能
ISE Design Suite 现在包含新 PlanAhead Lite，使得您能够获得获奖的 PlanAhead 设计和分析工具内的诸多特性。
默认优化内的改进，改进了大型模块（如 DSP48 和 BRAM）的布局、提高了歪斜突变（skew comutation）的精度、增强了分组和时钟布局器算法等。

终极生产率

ISE Design Suite 10.1 帮您更快地实现设计目标

从产品安装直到设计验证，ISE Design Suite 10.1 均能帮您充分利用您的时间和设计资源：

实现运行时间平均快 1.8 倍
PinAhead 技术新 PlanAhead Lite 能够提供早期的 FPGA 至 PCB I/O 定义。PinAhead 提供了管理复杂的 FPGA 和 PCB 间接口的工作的一个直观解决方案。
基于目标的设计实现了设置的自动分配，从而提供了专门针对您的设计目标（如性能、运行时间、面积或功耗）的结果。
通过与 EDA 合作，ISE Design Suite 将 RTL 仿真运行时间降低了高达 2 倍。
用于 Virtex-5 FPGA 硬 IP 仿真模型的业内首个 IEEE 加密让仿真运行时间比 SmartModels 的平均快2倍

功耗

动态功耗平均降低 12%

ISE 10.1 提供的工具和技术可以通过较早的、精确的功耗估计以及功率优化来帮您管理 FPGA 设计的功耗：

高级综合和实现算法将 Spartan-3A 系列与 Virtex-5 系列的动态功耗分别平均降低了12%和10%。
利用基于目标的实现，ISE 10.1提供了一个简单的一步式方法来阐明功耗优化
免费的、可下载的、领先的 Xilinx FPGA 的 XPower 估计器电子数据表让用户能够利用器件专用电子数据表工具快速而轻松地估计其项目的功耗。
XPower 分析器包含在 ISE 的所有配置中，它可以执行详细的基于设计的功耗分析，包括导入仿真文件来提供详细的设计精度。
找到与功耗有关的问题的答案，敬请登录 Xilinx 功耗解决方案，www.xilinx.com/cn/power