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Vivado
ISE
Vivado - 重要视频
Vivado High-Level Synthesis ( 高层次综合)
Vivado Design Suite 简介
ISE
辅导资料
ISE Design Suite 辅导资料
ISE Design Suite 技术
使用 Xilinx FPGAs 实现比特精度和周期精度的浮点DSP算法
使用项目浏览器集成Xilinx ChipScope 插入器
在团队设计中运用 HD 技术
如何使用 ISE 仿真器（ISim）
利用设计保存功能以实现可预测结果
利用 PlanAhead 实现部分重配置
快速浏览 PlanAhead™ 设计和分析工具
利用智能时钟门控实现功耗优化
项目浏览器（Project Navigator）12.1 的最新内容
如何利用 XPE 和 XPA 估计功耗
利用设计目标与策略以及 SmartXplorer 优化结果
利用 PlanAhead 设计和分析工具来提升设计性能
利用 iMPACT 实现的器件配置简介
Xilinx 嵌入式技术
Xilinx 软件开发套件简介
Xilinx DSP 技术
DSP 设计和验证：System Generator for DSP 简介
利用系统生成器（System Generator）和 SDK 协同调试嵌入式 DSP 设计
利用 System Generator for DSP 实现的硬件协仿真基础
实时硬件协仿真
System Generator for DSP 基于 Simulink 的 FPGA 功耗分析
系统生成器（System Generator）在 Linux 系统上的应用和安装
最新内容
ISE Design Suite: Logic Edition 11 的生产率提升
PlanAhead 11.1 的最新内容
入门
ISE Design Suite 11 – 软件产品与许可
如何利用 ChipScope™ Pro 调试设计
辅导资料
ISE Design Suite 辅导资料
ISE Design Suite 技术
ISE Design Suite – RTL/技术原理图查看器
利用 PlanAhead 和 ChipScope Pro 调试设计
利用多个约束文件
Xilinx 嵌入式技术
利用 ISE Design Suite 11 内的 Xilinx Platform Studio
利用 ISE Design Suite 11 内的 Base System Builder
Xilinx 合作伙伴信息
利用 7Circuits 和 PlanAhead 设计基于 FPGA 的系统
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