Xilinx 扩展 SmartConnect 技术,为 16nm UltraScale+ 器件实现 20%-30% 性能突破

Vivado Design Suite 2016.1 现提供 SmartConnect 技术支持,能解决高性能数百万系统逻辑单元设计中的系统互联瓶颈问题

Apr 21, 2016

2016 年 4 月 21 日,中国北京 - All Programmable 技术和器件的全球领先企业赛灵思公司(Xilinx, Inc. (NASDAQ:XLNX))今天宣布推出 Vivado® Design Suite 2016.1 的 HLx 版本。该全新套件新增了 SmartConnect 技术支持,能为 UltraScale™ 和 UltraScale+ 产品组合带来前所未有的高性能。Vivado Design Suite 2016.1 版本包含 SmartConnect 技术扩展,可解决高性能数百万系统逻辑单元设计中的系统互联瓶颈,从而让 UltraScale 和 UltraScale+ 器件组合在实现高利用率的同时,还能将性能进一步提升 20%-30%。

 

      赛灵思 UltraScale+ 产品组合是业界唯一一款基于 FinFET 的可编程技术。其包括 Zynq®、Kintex® 和 Virtex® UltraScale+ 器件,相对于 28nm 产品而言,性能功耗比提升 2-5 倍,能支持 5G 无线、软件定义网络和下一代高级驾驶员辅助系统等市场领先应用。

 

      赛灵思 SmartConnect 技术包括系统互联 IP 以及 UltraScale+ 芯片技术创新所带来的最新优化:

  • AXI SmartConnect IP:赛灵思的新型系统连接生成器将外设与用户设计整合在一起。SmartConnec t 创建的定制互联功能能最好地满足用户的系统性能要求,从而能以更少的占用面积和功耗实现更高的系统吞吐量。现在,用户可通过 Vivado Design Suite 2016.1版本中的 Vivado IP Integrator 抢先体验。
  • 借用时间和有用的歪斜优化:这些优化技术得到新型 UltraScale+ 精细时钟延迟插入功能的支持。这些全自动化功能通过将时序裕量从设计的高速路径转移到关键路径上,能够缓解大的线路延迟,并让设计运行在更高时钟频率上。
  • 流水线分析与重定时:这些方法通过在设计中增加额外的流水线级,并运用自动寄存器重定时优化技术,让设计人员能够进一步提高性能。

供货情况

      Vivado Design Suite HLx 版本和嵌入式软件开发工具 2016.1 版本现已开始供货,欢迎下载。如需了解有关赛灵思软件开发环境的更多信息,敬请访问赛灵思软件开发人员专区。如需了解有关 SmartConnect 技术的更多信息,欢迎下载背景介绍<提供链接>并访问以下网址:china.xilinx.com/smartconnect

 

关于赛灵思 UltraScale+ 产品系列                       

16nm UltraScale+ 系列 FPGA、3D IC 和 MPSoC 凭借新型存储器、3D-on-3D 和多处理 SoC(MPSoC)技术,继续保持着“领先一代”的价值优势。为实现前所未有的高的性能和集成度,UltraScale+ 系列还采用了全新的 SmartConnect 互联优化技术。通过系统级的优化,UltraScale+ 系列提供的价值远远超过了传统工艺节点移植所带来的价值,系统级性能功耗比相比 28nm 器件提升了 2-5倍,还实现了遥遥领先的系统集成度和智能化,以及最高级别的保密性与安全性。

关于赛灵思

赛灵思是 All Programmable FPGA、SoC、MPSoC 和 3D IC 的全球领先供应商,独特地实现了兼具软件定义和硬件最优化的各种应用,促进云技术、SDN/NFV、视频/视觉、工业物联网以及 5G 无线通信等产业的发展。如需了解更多信息,敬请访问赛灵思中文网站: http://china.xilinx.com/

                     

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