You are using a deprecated Browser. Internet Explorer is no longer supported by Xilinx.
解决方案
产品
技术支持
解决方案
产品
技术支持
解决方案（按技术分）
AI 推断加速
返回
AI 推断加速
为什么选择 Xilinx AI
Xilinx AI 解决方案
Xilinx AI 入门
视频 AI 分析
网络
应用商城
返回
应用商店
应用商城概述
Alveo 数据中心加速器应用
Kria SOM (System-on-Module) 应用
各行业的解决方案
汽车
返回
汽车
概述
ADAS
自动驾驶
电气化与联网
车载系统
广播与专业 A/V
返回
广播与专业 A/V
概述
AV over IP
相机
交换器与 KVM
编码器和解码器
专业音频系统
专业显示器和标牌
投影系统
路由器 & 交换机
服务器和存储器
发送器与调制器
视频会议
视频处理卡
消费电子
返回
消费电子
概述
音视频与娱乐
打印机
家居与生活方式
数据中心
返回
数据中心
概述
计算存储
数据库与数据分析
金融技术
高性能计算
网络加速
视频/图像处理
仿真与原型设计
返回
仿真与原型设计
概述
ASIC 仿真实现
基于 FPGA 的原型设计
工业
返回
工业
概述
3D 打印机与增材制造
人机接口
I/O 模块和智能传感器
IIoT 网关与边缘设备
采用工业物联网边缘节点实现工业控制
机器和计算机视觉
驱动／马达控制
机器人
智能电网
列车与铁路
视频监控
保健/医疗
返回
保健/医疗
概述
临床除颤器和自动体外除颤器
诊断与临床内镜处理
医疗保健 AI
CT、MRI 和 PET 医学成像
超声医学成像
多参数患者监护仪与心电图监测器
其他医疗设备
机器人辅助手术
安全性与合作伙伴解决方案
测试和测量
返回
测试和测量
概述
半导体自动测试设备
测试和测量仪器
有线测试器和无线测试器
有线 / 无线通信
返回
有线 / 无线通信
概述
网络安全性
电信加速
电信
无线
解决方案
产品
技术支持
产品类别
器件
返回
器件
探索芯片器件
ACAP
FPGA 和 3D IC
SoC、MPSoC、和 RFSoC
成本优化的产品组合
加速器
返回
加速器
数据中心加速器卡
计算存储
电信加速器
System-on-Modules (SOMs)
返回
System-on-Modules (SOMs)
SOM 概述
Kria SOM (System-on-Module)
Kria SOM 资源
面向 Kria SOM 的应用商城
使用 Kria 视觉 AI SOM 开始设计
什么是 SOM (System-on-Module)？
评估板与套件
返回
评估板与套件
探索开发板与套件
评估板
FPGA 夹层卡
开发板与套件附件
以太网适配器
返回
以太网适配器
Alveo SN1000 SmartNIC
Alveo U25 SmartNIC
NIC X2 系列卸载
NIC 8000 系列卸载
软件开发
返回
软件开发工具
Vitis™ 软件平台
Vitis™ AI 的强大功能
Vitis™ 加速库
Vitis™ Model Composer
旧版工具
软件开发资源
开发者网站 - developer.xilinx.com
Xilinx 加速器计划
Xilinx 社区门户
参考应用
硬件开发
返回
硬件开发工具
Vivado® ML
IP 核
Vitis™ Model Composer
硬件开发资源
开发者网站 - developer.xilinx.com
芯片评估板
设计中心
设计与调试博客
嵌入式开发
返回
嵌入式开发
嵌入式软件与生态系统
Xilinx Wiki 设计范例
Xilinx GitHub
Xilinx 社区门户
核心技术
返回
核心技术
探索所有内核技术
3D IC
AI 引擎
配置解决方案
连接功能
设计安全性
DSP
Dynamic Function eXchange
以太网
功能性安全
高速串行
机器学习
存储器
MIPI 成像连接
PCI Express
电源效率
处理解决方案
RF 采样
信号完整性
系统监视器和 XADC
应用商城
返回
应用商店
应用商城概述
Alveo 数据中心加速器应用
Kria SOM (System-on-Module) 应用
产品探索
开发者网站 - developer.xilinx.com
质量与可靠性
Powered By Xilinx
解决方案
产品
技术支持
技术支持与服务
技术支持
返回
技术支持
技术支持主页
知识库
技术文档
社区论坛
服务门户
设计中心
Versal ACAP 设计流程文档
下载与许可
服务
返回
服务
培训
下载与许可
产品退货
大学计划
合作伙伴设计服务
求职
公司简介
返回
公司简介
Xilinx 公司介绍
管理团队
投资者关系
Xilinx Ventures
社区参与计划
企业责任
企业简报中心
求职
合作伙伴
返回
合作伙伴
Xilinx 合作伙伴计划概述
合作伙伴计划详情
探索合作伙伴解决方案
加速器与开发者计划
联系我们
返回
联系我们
联系 Xilinx
联系销售
公司地点
授权分销商
新闻与媒体
新闻专区
新闻发布
研讨会
视频门户
Powered By Xilinx
社区
Xilinx 博客
活动
社区论坛
购物车
Sub Total
Shipping
Calculated at Checkout
Tax
Calculated at Checkout
Secure Checkout
Your cart is empty
Looks like you have no items in your shopping cart.
Click here
to continue shopping
账户
登录 | 注册
退出
搜索
全部
芯片器件
开发板与套件
IP
技术支持
技术文档
知识库
社区论坛
合作伙伴
视频
新闻稿
搜索
技术支持
AR# 4766: F1.5F2.1i ABEL - Abl2edif creates an incorrect netlist when the underscore character is used at the end of a signal name: give based:24 error in translate
反馈
关闭