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AR# 66071

Zynq UltraScale+ MPSoC 器件的设计咨询主答复记录

描述

Zynq 数据表、技术参考手册和其他文档均包含 Zynq UltraScale+ MPSoC 器件。

此处列举了重要的设计咨询和其他超出这些文档范围的重要事项。

技术内容来源: Xilinx Zynq UltraScale+ MPSoC 解决方案中心

解决方案

2019 年 8 月 12 日发布的设计咨询提醒

(Xilinx Answer 72572)Zynq UltraScale+ MPSoC/RFSoC 设计咨询:2019.1 XilSKeyPUF 注册错误[SECURITY]
(Xilinx Answer 72588)Zynq UltraScale + MPSoC / RFSoC 的设计咨询:仅加密启动模式 未经身份验证的引导和分区标头[SECURITY]

2019 年 4 月 22 日发布的设计咨询提醒

(Xilinx Answer 71952)Zynq UltraScale + MPSoC / RFSoC的设计咨询:在 PS_POR_B 置位后,PMU GPO1 [2](MIO34)上可能会出现毛刺


2018 年 8 月 6 日发布的设计咨询提醒

(Xilinx Answer 71293)  Zynq UltraScale+ MPSoC 的设计咨询:2017.x FSBL 根据分区报头的内容在分区上执行安全操作。[SECURITY]
(Xilinx Answer 71326)  2017.x、2018.1 或 2018.2 的 FSBL 不检查所有 RSA_EN eFUSE[SECURITY]


2017 年 3 月 19 日发布的设计咨询提醒:

(Xilinx Answer 70622)Zynq UltraScale+ MPSoC 的设计咨询:2017.x Xilinx 开发工具和软件在多个分区中重复使用相同的 AES 密钥和 IV 对。[SECURITY]


2017 年 4 月 17 日发布的设计咨询提醒:

(Xilinx Answer 69034)7 系列、UltraScale 和 UltraScale+ 的设计咨询,Vivado 2016.3 之前的所有版本都没有包括差分 I/O 标准的飞行时间延迟。
(Xilinx Answer 68615)Zynq UltraScale+ MPSoC 的设计咨询:如果第一个参数页面有数据损坏,从 NAND 启动可能就会失败。

2017 年 4 月 10 日发布的设计咨询提醒:

(Xilinx Answer 68832)采用 Vivado 2016.4(或更早版本)进行 UltraScale FPGA、UltraScale+ FPGA 以及 Zynq UltraScale+ MPSoC eFUSE 编程的设计咨询[SECURITY]

2016 年 12 月 5 日发布的设计咨询提醒

(Xilinx Answer 68210)FSBL 在外部 DDR 中验证引导镜像[SECURITY]

设计咨询提醒: 2016.10.17

(Xilinx Answer 67861)如何从 Vivado 2016.2 或更早的版本更新

设计咨询提醒: 2016.4.18

(Xilinx Answer 66944)面向 Zynq UltraScale+ MPSoC 和 Kintex UltraScale+ FPGA 的设计咨询- 更新的封装引脚

链接问答记录

主要问答记录

Answer Number 问答标题 问题版本 已解决问题的版本
64375 Xilinx Zynq UltraScale+ MPSoC Solution Center N/A N/A
66183 Zynq UltraScale+ MPSoC Processing System IP - Release Notes and Known Issues N/A N/A

子答复记录

AR# 66071
日期 08/08/2019
状态 Active
Type 设计咨询
器件
的页面