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AR# 71399

UltraScale+ PCI Express 4c 集成块 —版本说明与已知问题

描述

本答复记录包含 UltraScale+ PCI Express 4c 集成块内核的版本说明及已知问题,以及以下内容:

  • 一般信息
  • 已知和已解决的问题
  • 修订历史

本文是 PCI Express 解决方案中心的一部分

(Xilinx Answer 34536)面向 PCI Express 的 XIlinx 解决方案中心

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解决方案

支持的器件可在以下位置找到:

  • 打开 Vivado 工具 -> IP 目录,右键点击某个 IP 并选择各兼容系列
  • 如欲查看新特性列表和所有版本添加的器件支持,请参见 Vivado 设计工具中提供该核的 Change Log 文件。

版本表

此表将内核版本关联至首个包含该表的 Vivado 设计工具发布版本。

核版本Vivado 工具版本
v1.0 (Rev4)2018.3
v1.0 (Rev3)2018.2
v1.0 (Rev2)
2018.1
v1.0 (Rev1)2017.4
v1.02017.3


战术补丁

下表是一系列战术补丁,适用于在相应 Vivado 工具版本上适用的 UltraScale+ PCI Express 集成块内核。

答复记录内核版本(安装补丁后)工具版本
v1.3 (Rev3)
2018.2


已知和已解决的问题

下表是 UltraScale+ PCI Express 集成块内核的已知问题,首先是 v1.0,最初在 Vivado 2017.3 中发布。

注:“发现问题的版本”栏列出了首次发现问题的版本。

该问题可能也出现于较早版本,但未对较早版本进行特定测试。

答复记录标题发现问题的版本已解决的问题
(Xilinx Answer 71498)
MCP(多周期路径)对 ES1 部件缺失 RQSEQNUM * 信号的约束v1.3 (Rev3)尚未解决
所提供的战术补丁
(Xilinx Answer 71375)在 125MHz 和 250MHz 速度下,Link 不通过 Refclk 进行 Gen1 设计v1.3 (Rev2)
v1.3 (Rev3)


其他信息:

NA

修订历史::

08/01/2018 - 初始版本

09/05/2018 - 新增 (Xilinx Answer 71498)

AR# 71399
日期 02/14/2019
状态 Active
Type 版本说明
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