AMD 提供 HDMI2.1 IP 子系统和 HDMI2.0 IP 子系统。HDMI2.1 子系统针对 HDMI2.1 规范精心设计,支持针对 FRL 和 TMDS 模式以及高达 48Gbps 的吞吐量提供支持的早期 HDMI 标准。 HDMI2.0 IP 子系统针对 HDMI2.0 规范精心设计,支持早期标准,可针对 TMDS 信令提供每秒高达 18Gb 的吞吐量。
HDMI2.1 子系统支持 Ultrascale+ 器件。
HDMI2.0 子系统支持 Versal™ 自适应 SoC、UltraScale+™、UltraScale 和 7 系列 AMD FPGA。
为了帮助用户采用 HDMI 接口创建视频解决方案,AMD 为 HDMI 接收或 HDMI 发送提供了预封装子系统。这些子系统将支各种通用功能(持视频时序生成、AXI 桥接以及可选 HDCP 功能等视频接口)与 HDMI 控制器集成,开盒即可投入使用。这些子系统需要额外的 HDMI GT 控制器 (HDMI2.1) 或视频物理层控制器 (HDMI2.0) 来实现物理层。
HDMI 子系统符合 HDMI 2.0 标准,包括以下特性:
HDMI 2.1 子系统符合 HDMI 2.1 标准,包括以下特性: