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AR# 66944

有关 Zynq UltraScale+ MPSoC 的设计咨询 - 自 2016 年 4 月 5 日起,更新与 Xilinx.com 相关的封装管脚

描述

Zynq UltraScale+ MPSoC 封装管脚已经根据最近在 Xilinx.com 中提供的管脚进行了改变。

解决方案

CSV 管脚文件:

  • 公共 Zynq UltraScale+ 文件已在 Xilinx.com 上更新为 4/5/2016。

受影响的 Zynq UltraScale+ 封装:

xczu11egffvb1517 (1)

xczu11egffvc1760 (1) (2)

xczu11egffvf1517 (1) (3)

xczu17egffvb1517 (1)

xczu17egffvc1760 (1)

xczu17egffvd1760 (1)

xczu17egffve1924 (1)

xczu19egffvb1517 (1)

xczu19egffvc1760 (1)

xczu19egffvd1760 (1)

xczu19egffve1924 (1)

xczu2egsbva484 (1) (4)

xczu2egsfva625 (2)

xczu2egsfvc784 (1) (2) (3) (4) (5)

xczu3egsfva625 (2)

xczu3egsfvc784 (1) (2) (3) (4) (5)

引脚差异的关键:

  • (1) SelectIO
  • (2) 供电
  • (3) GT
  • (4) PS MIO
  • (5) 专用/配置

没有受影响的 Zynq UltraScale+ 封装:

xczu9egffvb1156

xczu9egffvc900

xczu15egffvb1156

xczu15egffvc900

xczu6egffvb1156

xczu6egffvc900

本答复记录附带了 Zynq UltraScale+ 受影响器件的差异比较。

附件

文件名 文件大小 File Type
AR66944_csv_diff.zip 21 KB ZIP

链接问答记录

主要问答记录

Answer Number 问答标题 问题版本 已解决问题的版本
66071 Zynq UltraScale+ MPSoC 器件的设计咨询主答复记录 N/A N/A
AR# 66944
日期 08/23/2016
状态 Active
Type 设计咨询
器件
  • Zynq UltraScale+ MPSoC
Tools
  • Vivado Design Suite - 2016.1
  • Vivado Design Suite - 2015.4
  • Vivado Design Suite - 2016.2
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