本答复记录包含 Virtex UltraScale+ HBM 控制器的发布说明与已知问题,其中包括以下内容:
本发行说明和已知问题答复记录适用于Vivado 2018.1和更新工具版本中生成的核。
Xilinx 论坛:
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概述
支持的器件可在以下位置找到:
https://china.xilinx.com/support/documentation/white_papers/c_wp485-hbm.pdf
如欲查看新特性列表和所有版本添加的器件支持,请参见 Vivado 工具中提供该核的 Change Log 文件。
表 1 将内核版本关联至首个包含该表的 Vivado 设计工具发布版本。
表 1: 版本
HBM 版本 | Vivado 工具版本 |
v1.0 | 2018.1 |
v1.0 (Rev. 1) | 2018.2 |
v1.0 (Rev. 2) | 2018.3 |
v1.0 (Rev. 3) | 2019.1 |
v1.0 (Rev. 4) | 2019.1.1 |
v1.0 (Rev. 4) | 2019.1.2 |
v1.0 (Rev. 4) | 2019.1.3 |
v1.0 (Rev. 5) | 2019.2 |
v1.0 (Rev. 6) | 2019.2.1 |
v1.0 (Rev. 6) | 2019.2.2 |
v1.0 (Rev. 7) | 2020.1 |
如欲查看 UltraScale 系列 FPGA 的支持内存接口和工作频率列表,请访问存储器解决方案页面的内部存储器接口部分:
如欲了解 Vivado 全新功能的最新信息,包括支持性操作系统和 IP 产品说明,请查看 (UG973)。
已知问题和已解决的问题
表 2 提供了 Virtex UltraScale + HBM 控制器的已知问题和已解决的问题
该问题可能也出现于较早版本,但未对较早版本进行特定测试。
表 2:已知问题和已解决问题
修订历史::
2018.1 中的全新 IP | |
新增 71312 | |
2018.3 更新 | |
12/10/2018 | 更新了 AR#71097 的描述,增加了 AR#71795 |
01/07/2019 | Updated description of AR#71097, added AR#71894 and AR#71895 |
05/02/2019 | 2019.1 更新 |
07/30/2019 | Added AR#72607 and AR#72608 |
2019.2 更新 | |
Added AR#73028 | |
Updated description of AR#71097 | |
Added AR#73372 | |
Added AR#73712; Updated for 2020.1 |
AR# 69267 | |
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日期 | 06/10/2020 |
状态 | Active |
Type | 发布说明 |
器件 | |
Tools | |
IP |